[发明专利]量化逻辑之多值幅权总线控制器在审
| 申请号： | 201711119712.5 | 申请日： | 2017-10-30 |
| 公开（公告）号： | CN109725876A | 公开（公告）日： | 2019-05-07 |
| 发明（设计）人： | 胡五生 | 申请（专利权）人： | 胡五生 |
| 主分类号： | G06F7/38 | 分类号： | G06F7/38 |
| 代理公司： | 暂无信息 | 代理人： | 暂无信息 |
| 地址： | 741002 甘肃省*** | 国省代码： | 甘肃;62 |
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| 摘要： | 幅权总线控制器是由通用指令控制器和总线模拟开关组成，所述的通用指令控制器由位权量化器、标记生成电路和分形隔离输出电路及时钟同步控制组成，用指令控制器的输出驱动模拟开关的逻辑控制端组成的总线控制器，模拟开关控制端是由一组和总线数据等长的模拟开关组构成，各模拟开关组的正逻辑控制端连接在一起作为控制正端，各模拟开关组的负控端连接在一起作为负控端，用通用二值非门组合产生正反控制信息，分形隔离输出编辑成两路一对的控制输出，经二值与逻辑电路插入时钟控制，二值与逻辑电路的输出驱动模拟开关的控制输入端，各组模拟开关的模拟输入端是单组数据输入输出通路，模拟开关组的另一模拟输入输出端按既定序号分别与总线连接。 | ||
| 搜索关键词： | 模拟开关组 总线控制器 模拟开关 输出驱动 通用指令 控制器 与逻辑 分形 电路 模拟开关控制端 标记生成电路 隔离输出电路 输入输出通路 控制输入端 模拟输入端 输入输出端 指令控制器 单组数据 隔离输出 开关组成 逻辑控制 时钟控制 同步控制 正反控制 总线连接 总线模拟 总线数据 控制端 量化器 正逻辑 等长 非门 两路 正端 量化 输出 通用 | ||
【主权项】：
1.幅权总线控制器是由通用指令控制器和总线模拟开关组成，所述的通用指令控制器由位权量化器、标记生成电路和分形隔离输出电路及时钟同步控制组成，用所述的指令控制器的输出驱动模拟开关的逻辑控制端组成的总线控制器，所述的模拟开关控制端是由一组和总线数据等长的模拟开关组构成，各模拟开关组的正逻辑控制端连接在一起作为控制正端，各模拟开关组的负控端连接在一起作为负控端，用通用二值非门组合产生正反控制信息，所述的分形隔离输出编辑成两路一对的控制输出，经二值与逻辑电路插入时钟控制，二值与逻辑电路的输出驱动模拟开关的控制输入端，各组模拟开关的模拟输入端是单组数据输入输出通路，模拟开关组的另一模拟输入输出端按既定序号分别与总线连接，所述的通用指令控制器有二值四输出、三值九输出、四值十六输出、五值二十五输出、六值三十六输出、七值四十九输出、八值六十四输出、九值八十一输出、十值一百输出，指令控制器的一条指令输出控制一对输入输出进行数据交换。
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- 一种多位多值寄存器由多个权值寄存器组成，所述的权值寄存器有二进制，三进制，四进制.......十进制N进制，所述的权值寄存器是由传统的二值寄存器组合而成，二进制用两个二值寄存器，三进制用三个二值寄存器，四进制用四个二值寄存器......十进制用十个二值寄存器，分别把一位位权码中的权值a0，a1，a2，........an用各自独立的二值寄存器Q0，Q1，Q2，...Qn进行保存，使得权值a0接Q0的输入端，权值a1接Q1的输入端，权值a2接Q2的输入端，.......权值an接Qn的输入端，各控制线直接连接，构成一个控制输入端，二值寄存器Q0，Q1，Q2，...Qn的输出经二极管d0，d1，d2，d3，......dn隔离构成权值输出a0，a1，a2，........an；为所述的权值寄存器。
- 多进制算数运算器-201710024248.5
- 胡五生 - 胡五生
- 2017-01-03 - 2018-07-10 - G06F7/38
- 一种多位多进制算数运算器由多值运算器核心组合连接组成，运算核心有加法器、乘法器、减法器、9补器、除法器，所述的运算核心均由“标记生成电路”和“赋意分形算法电路”组成，把“标记生成电路”电路输出的标记信息a0b0，a0b1.....a1b0，a1b1......a2b0，a2b1....anbn对应的和“赋意分形算法电路”的标记输入同名端a0b0，a0b1.....a1b0，a1b1......a2b0，a2b1....anbn分别连接，标记生成电路的两个输入端为运算核心的两个输入，赋意分形算法电路的进位和本位输出是运算核心的进位和本位输出。
- 数字绳码编码解码及加减乘除倒数算术电路设计的方法-200810086016.3
- 魏营隆 - 魏营隆
- 2008-03-11 - 2018-02-02 - G06F7/38
- 计算机及单片机的编码与算术运算采用二进制规则，用二进制规则进行算术运算必须发生进位与借位，进位与借位极大地影响运算速度。本发明是一种运算码的编码、解码、算术运算的方法，构建的算术运算电路是把二进制码编码成运算码，由运算码进行算术运算，运算结束后再把运算码解码成二进制码。优点是电路级数少，把二进制数操作数(整数、定点数、浮点数)送入运算电路到二进制运算结果从电路中输出，加减运算的电路级数小于10级，乘法运算与倒数运算的电路级数小于25级，除法运算的电路级数小于45级。所用的电子元件少，不仅能集成到计算机的CPU里，还能集成到单片机的CPU里。
- 一种整数间的计算方法、装置及计算机存储介质-201710866135.X
- 李华念 - 郑州云海信息技术有限公司
- 2017-09-22 - 2018-01-26 - G06F7/38
- 本发明公开了一种整数间的计算方法、装置及计算机存储介质，该方法的步骤包括获取第一整数以及第二整数；其中第一整数以及第二整数均为十六进制形式；将第一整数以及第二整数分别分割为相同数量的整数段以得到第一整数段集合与第二整数段集合，并记录各整数段间的顺序；其中各整数段的位数均相同；根据第一整数与第二整数的符号特性，分别对第一整数段集合与第二整数段集合之间各相同数位的目标整数段进行相应运算以得到结果段集合；依照整数段的顺序将结果段集合中的结果段进行组合以得到计算结果。可见本方法扩大了计算机语言能够计算的整数的范围，并且避免了数据溢出的情况，保证了结果数据的安全性、准确性以及可用性。
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