[发明专利]一种基于可复用Booth乘法单元的存内计算电路在审
| 申请号： | 202310945599.5 | 申请日： | 2023-07-28 |
| 公开（公告）号： | CN116959517A | 公开（公告）日： | 2023-10-27 |
| 发明（设计）人： | 贺雅娟;金正浩;武晗;潘本浩;张波 | 申请（专利权）人： | 电子科技大学 |
| 主分类号： | G11C7/10 | 分类号： | G11C7/10;G11C7/12;G11C7/18;G06F7/52;G06N3/04 |
| 代理公司： | 成都点睛专利代理事务所(普通合伙) 51232 | 代理人： | 孙一峰 |
| 地址： | 611731 四川省*** | 国省代码： | 四川;51 |
| 权利要求书： | 暂无信息 | 说明书： | 暂无信息 |
| 摘要： | 本发明属于集成电路技术领域，具体的说是一种基于可复用Booth乘法单元的存内计算电路。本发明在传统6T‑SRAM存储单元基础上添加两个晶体管，控制局部计算数据线进行多行数据复用，并且增加Booth编码器对局部计算数据线中的数据编码，再利用Booth译码器和积产生电路完成8比特数据乘法，最后通过加法器树累加各个乘法结果实现了在SRAM存储阵列中完成多组数据的乘法累加运算。本发明了实现了高效的8比特SRAM存内计算，具有存储密度大，灵活性高的特点，能够在存内计算操作的同时进行读写操作，适用于需要大规模矩阵运算的数据密集型应用，如神经网络。 | ||
| 搜索关键词： | 一种 基于 可复用 booth 乘法 单元 计算 电路 | ||
【主权项】：
暂无信息
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