[发明专利]触摸识别和数码显示集成电路及其外接电路和访问方法有效
申请号: | 201510215856.5 | 申请日: | 2015-04-30 |
公开(公告)号: | CN104808852B | 公开(公告)日: | 2017-12-01 |
发明(设计)人: | 施隆照;江典棋;林鸿;朱宇耀;黄淑燕 | 申请(专利权)人: | 福州福大海矽微电子有限公司 |
主分类号: | G06F3/041 | 分类号: | G06F3/041;G09G3/32 |
代理公司: | 福州元创专利商标代理有限公司35100 | 代理人: | 蔡学俊 |
地址: | 350002 福建省福州市*** | 国省代码: | 福建;35 |
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摘要: | |||
搜索关键词: | 触摸 识别 数码 显示 集成电路 及其 外接 电路 访问 方法 | ||
技术领域
本发明涉及一种触摸识别和数码显示集成电路,以及该集成电路的外接电路和访问方法。
背景技术
传统面板上使用触摸按键和数码管显示的方案一般是采用一个独立触摸按键的识别芯片和一个独立驱动数码管以及LED灯显示芯片,或者采用分立器件实现触摸按键识别或驱动数码管以及LED显示,但是该两个方案的实现需要占用上位机中的很多管脚,不仅占用了很大的布板面积,极为浪费空间,而且需花费更高的成本,相关芯片的使用效率也很低,且上位机对各个芯片的访问方式也极为复杂。
发明内容
本发明的目的在于克服如上述现有技术方案中存在的弊端,提供一种既可实现触摸识别,也可实现数码显示的集成电路,同时还提供了该集成电路的外接电路以及访问方法,
为实现上述目的,本发明的技术方案是:一种触摸识别和数码显示集成电路,其特征在于,所述集成电路包括:时钟产生模块、复位产生模块、LDO模块、串行通信协议模块、芯片控制模块、数码管与LED灯显示模块、按键识别模块以及加密模块;该集成电路在具备触摸按键识别功能的同时,还能驱动数码管显示或LED灯显示;
所述时钟产生模块的第一端分别与所述串行通信协议模块的第一端、所述芯片控制模块第一端、所述数码管与LED灯显示模块第一端、所述按键识别模块第一端以及所述加密模块第一端相连;
所述复位产生模块的输出端分别与所述串行通信协议模块第二端、所述芯片控制模块的第二端、所述加密模块输入端的第二端、所述数码管与LED灯显示模块的第二端以及所述按键识别模块的第二端相连;
所述LDO模块的输出端分别与所述时钟产生模块的电源端以及所述按键识别模块的电源端相连;所述LDO模块用于为所述时钟产生模块和所述按键识别模块提供一稳定电压;
所述串行通信协议模块的第三端与所述芯片控制模块的第三端相连;所述串行通信协议模块的第四端与所述数码管与LED灯显示模块的第三端相连;所述串行通信协议模块的第五端与所述按键识别模块的第三端相连;所述串行通信协议模块的第六端为该集成电路的SCL时钟端,且上位机经该SCL时钟端输入串行通信的时钟;所述串行通信协议模块的第七端为该集成电路的SDA数据端,且上位机经该SDA数据端输入或读取串行通信的数据;
所述芯片控制模块的第四端与所述数码管与LED灯显示模块的第四端相连;所述芯片控制模块的第五端与所述按键识别模块的第四端相连;所述芯片控制模块的第六端与所述加密模块第三端相连;
所述按键识别模块的第一识别端至第八识别端分别对应连接至第一逻辑电路的第一端至第八逻辑电路的第一端,所述数码管与LED灯显示模块的第一输出端至第八输出端分别对应连接至第一逻辑电路的第二端至第八逻辑电路的第二端,且所述第一逻辑电路的第三端至所述第八逻辑电路的第三端分别作为该集成电路的第一复用端至第八复用端;
所述按键识别模块的第九识别端至第十二识别端分别对应连接至第九逻辑电路的第一端至第十二逻辑电路的第一端,所述数码管与LED灯显示模块的第九输出端至第十二输出端对应连接至第九逻辑电路的第二端至第十二逻辑电路的第二端,且所述第九逻辑电路的第三端至所述第十二逻辑电路的第三端分别作为该集成电路的第九复用端至第十二复用端。
在本发明一实施例中,该集成电路按照如下方式进行封装:管脚1为端口E/KEY5;管脚2为端口D/KEY4;管脚3为端口DP/KEY8;管脚4为端口C/KEY3;管脚5为端口G/KEY7;管脚6为端口DIG4/KEY12;管脚7为端口GND;管脚8为端口VDD;管脚9为端口B/KEY2;管脚10为端口DIG3/KEY11;管脚11为端口DIG2/KEY10;管脚12为端口SCL;管脚13为端口SDA;管脚14为端口F/KEY6;管脚15为端口DIG1/KEY9;管脚16为端口A/KEY1;其中,所述管脚16、所述管脚9、所述管脚4、所述管脚2、所述管脚1、所述管脚14、所述管脚5以及所述管脚3分别与该集成电路的第一复用端至第八复用端相连;所述管脚15、所述管脚11、所述管脚10以及所述管脚6分别与该集成电路的第九复用端至第十二复用端相连。
在本发明一实施例中,所述第一逻辑电路至所述第十二逻辑电路内部均包括一输入逻辑电路和一输出逻辑电路;所述输入逻辑电路包括依次连接的一电平转换电路和一斯密特触发电路;所述输出逻辑电路包括依次连接的一三态输出电路和一ESD电路。
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