[发明专利]检查芯片设计中输入输出元件是否有连线错误的装置和方法无效
| 申请号： | 201210156765.5 | 申请日： | 2012-05-18 |
| 公开（公告）号： | CN103425807A | 公开（公告）日： | 2013-12-04 |
| 发明（设计）人： | 余美俪;罗幼岚;高淑怡 | 申请（专利权）人： | 瑞昱半导体股份有限公司 |
| 主分类号： | G06F17/50 | 分类号： | G06F17/50 |
| 代理公司： | 隆天国际知识产权代理有限公司 72003 | 代理人： | 张龙哺;冯志云 |
| 地址： | 中国台*** | 国省代码： | 中国台湾;71 |
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| 摘要： | 一种检查一芯片设计中输入输出元件是否有连线错误的装置和方法，其中该芯片设计包含有多个输入输出元件及多个电路区块，该方法包含下列步骤：依据一输入输出元件的一属性所对应的一检查项目来检查该输入输出元件与一区块元件的连线，以产生一检查结果；并依据该检查结果以判断该多个输入输出元件是否有连线错误的情形。 | ||
| 搜索关键词： | 检查 芯片 设计 输入输出 元件 是否 连线 错误 装置 方法 | ||
【主权项】：
一种检查一芯片设计中输入输出元件是否有连线错误的装置，该芯片设计包含有多个输入输出元件及多个电路区块，该装置具有：检查模块，依据一输入输出元件的一属性所对应的一检查项目来检查该输入输出元件与一区块元件的连线，以产生一检查结果；以及判断模块，依据该检查结果来判断该输入输出元件是否有连线错误。
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