[实用新型]一种图像像元合并的电路有效

专利信息
申请号: 201220463607.X 申请日: 2012-09-12
公开(公告)号: CN202841351U 公开(公告)日: 2013-03-27
发明(设计)人: 张健;许哲;杨文才;李爱玲;白喆;单金玲;赵燕 申请(专利权)人: 中国科学院西安光学精密机械研究所
主分类号: H04N5/369 分类号: H04N5/369;H04N5/378
代理公司: 西安智邦专利商标代理有限公司 61211 代理人: 张倩
地址: 710119 陕西省西*** 国省代码: 陕西;61
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摘要: 实用新型涉及一种图像像元合并的电路,包括A/D转换器、D触发器,第一全加器、第二全加器、存储器以及时序发生器,模拟图像信号送入A/D转换器的输入端,A/D转换器的输出端分别与D触发器输入端和第一全加器的输入端B相连,D触发器的输出端与第一全加器的输入端A相连,所述第一全加器的输出端分别与存储器的写入数据端和第二全加器的输入端A相连,所述存储器的读出数据端与第二全加器的输入端B相连,时序发生器分别为A/D转换器、D触发器、第一全加器、第二全加器以及存储器提供工作时序。本实用新型克服了不具备片内合并功能的CCD和CMOS芯片的使用局限性,具有低功耗、低成本、高稳定、易实现的优点。
搜索关键词: 一种 图像 合并 电路
【主权项】:
一种图像像元合并的电路,其特征在于:包括A/D转换器、D触发器,第一全加器、第二全加器、存储器以及时序发生器,模拟图像信号送入A/D转换器的输入端,所述A/D转换器的输出端分别与D触发器输入端和第一全加器的输入端B相连,所述D触发器的输出端与第一全加器的输入端A相连,所述第一全加器的输出端分别与存储器的写入数据端和第二全加器的输入端A相连,所述存储器的读出数据端与第二全加器的输入端B相连,所述时序发生器分别为A/D转换器、D触发器、第一全加器、第二全加器以及存储器提供工作时序。
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