[发明专利]可配置的混合加法器电路有效
申请号: | 201410173101.9 | 申请日: | 2009-04-24 |
公开(公告)号: | CN104020980B | 公开(公告)日: | 2017-12-22 |
发明(设计)人: | E·J·皮斯托瑞司;M·D·胡顿 | 申请(专利权)人: | 阿尔特拉公司 |
主分类号: | G06F7/508 | 分类号: | G06F7/508 |
代理公司: | 北京纪凯知识产权代理有限公司11245 | 代理人: | 赵蓉民 |
地址: | 美国加*** | 国省代码: | 暂无信息 |
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摘要: | 提供一种用于集成电路如可编程集成电路的混合加法器电路。该混合加法器可以组合多个加法器体系结构的性能。混合加法器可以包括进位选择加法器电路和进位行波加法器电路。可以利用进位超前体系结构组合这些加法器电路。可以利用可编程集成电路上的逻辑区的资源来实现加法器功能。每个逻辑区可以包括诸如查寻表逻辑之类的组合逻辑和寄存器电路。混合加法器电路可以从组合电路接收要相加的输入字,并且可以为寄存器电路产生相应的算术和输出信号。 | ||
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【主权项】:
一种将进位输出信号路由到加法器的输出的方法,该加法器具有在集成电路上形成链的多个加法器电路,其中所述加法器执行两个输入字的加法以产生所述两个输入字的算术和,其中所述加法器电路的链具有带有和输出路径的最后一个加法器电路,其中每个加法器电路提供至少一个进位输出,且其中每个加法器电路具有至少一个进位输入,所述方法包括:配置所述集成电路上的可编程逻辑以向所述最后一个加法器提供固定值的输入信号,其中相应的固定信号被提供给所述最后一个加法器中至少一个多路复用器的输入;在加法操作中,在所述最后一个加法器电路的所述进位输入处接收来自所述链中一个其他加法器电路的进位信号;和通过所接收的进位信号,控制所述多路复用器将所述固定信号中的一个给定信号路由到所述和输出路径以形成进位输出信号,其中在所述最后一个加法器电路的所述和输出路径处的所述进位输出信号形成所述算术和的最高位。
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- 2009-04-24 - 2017-12-22 - G06F7/508
- 提供一种用于集成电路如可编程集成电路的混合加法器电路。该混合加法器可以组合多个加法器体系结构的性能。混合加法器可以包括进位选择加法器电路和进位行波加法器电路。可以利用进位超前体系结构组合这些加法器电路。可以利用可编程集成电路上的逻辑区的资源来实现加法器功能。每个逻辑区可以包括诸如查寻表逻辑之类的组合逻辑和寄存器电路。混合加法器电路可以从组合电路接收要相加的输入字,并且可以为寄存器电路产生相应的算术和输出信号。
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