[发明专利]基于FPGA的FFT装置及方法有效
申请号: | 201610024296.X | 申请日: | 2016-01-14 |
公开(公告)号: | CN106970895B | 公开(公告)日: | 2023-10-03 |
发明(设计)人: | 王纪宁 | 申请(专利权)人: | 普天信息技术有限公司 |
主分类号: | G06F17/14 | 分类号: | G06F17/14;G06F9/355 |
代理公司: | 北京路浩知识产权代理有限公司 11002 | 代理人: | 李相雨 |
地址: | 100080 北京*** | 国省代码: | 北京;11 |
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摘要: | 本发明涉及一种基于FPGA的FFT装置及方法,该装置包括:缓存模块、控制模块和基‑4蝶形运算器;所述控制模块分别与缓存模块和基‑4蝶形运算器相连,用于控制数据的输入、输出,用于控制数据以乒乓缓存的方式缓存至缓存模块中,用于控制数据以循环寻址的方式在基‑4蝶形运算器中完成FFT运算;所述缓存模块用于初始输入前3/4的数据,输出后3/4的运算结果,并用于保存中间结果;所述基‑4蝶形运算器用于初始输入后1/4的数据,输出前1/4的运算结果。本发明提高了运算速度,在DSP乘法器使用数量与应用基‑2蝶形运算单元的FFT装置相当的情况下减少了存储数据的RAM的总深度。 | ||
搜索关键词: | 基于 fpga fft 装置 方法 | ||
【主权项】:
一种基于FPGA的FFT装置,其特征在于,包括:缓存模块、控制模块和基‑4蝶形运算器;所述控制模块分别与缓存模块和基‑4蝶形运算器相连,用于控制数据的输入、输出,用于控制数据以乒乓缓存的方式缓存至缓存模块中,用于控制数据以循环寻址的方式在基‑4蝶形运算器中完成FFT运算;所述缓存模块用于初始输入前3/4的数据,输出后3/4的运算结果,并用于保存中间数据;所述基‑4蝶形运算器用于初始输入后1/4的数据,输出前1/4的运算结果。
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