[实用新型]基于高速DDS的捷变频率源有效
| 申请号： | 201820732418.5 | 申请日： | 2018-05-17 |
| 公开（公告）号： | CN207968464U | 公开（公告）日： | 2018-10-12 |
| 发明（设计）人： | 张江涛;任彦闯 | 申请（专利权）人： | 石家庄雷迅电子科技有限公司 |
| 主分类号： | H03L7/16 | 分类号： | H03L7/16 |
| 代理公司： | 暂无信息 | 代理人： | 暂无信息 |
| 地址： | 050000 河北省石家庄*** | 国省代码： | 河北;13 |
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| 摘要： | 本实用新型公开了一种基于高速DDS的捷变频率源，包括锁相环、高速DDS、FPGA以及开关滤波器组，其中锁相环连接高速DDS的输入端，为高速DDS提供参考时钟信号，高速DDS的输出连接开关滤波器组的输入，高速DDS产生快速跳频信号经开关滤波器组进行分段滤波后输出。本实用新型通过FPGA根据外部输入的控制码控制高速DDS产生捷变频率信号，并通过由FPGA控制的切换开关来选择不同的滤波器进行滤波输出，利用高速DDS的纳秒级捷变频率特点，并通过滤波器的带外抑制，滤除带外杂散，避免DDS输出的杂散落在要求的频带内，实现了宽带快速捷变频以及低杂散输出。 | ||
| 搜索关键词： | 高速DDS 滤波器 开关滤波器组 本实用新型 频率源 锁相环 输出 杂散 参考时钟信号 输出连接开关 变频率信号 带外抑制 快速跳频 滤波器组 滤波输出 切换开关 捷变频 控制码 纳秒级 输入端 宽带 滤波 滤除 分段 散落 外部 | ||
【主权项】：
1.一种基于高速DDS的捷变频率源，其特征在于：包括锁相环、高速DDS、FPGA以及开关滤波器组，其中锁相环连接高速DDS的输入端，为高速DDS提供参考时钟信号，高速DDS的输出连接开关滤波器组的输入，高速DDS产生快速跳频信号经开关滤波器组进行分段滤波后输出，FPGA的输出分别连接锁相环、开关滤波器组的控制端以及为高速DDS提供频率控制数据。
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