[发明专利]一种基于SerDes的TDC实现装置在审
申请号: | 202310219013.7 | 申请日: | 2023-03-08 |
公开(公告)号: | CN116360235A | 公开(公告)日: | 2023-06-30 |
发明(设计)人: | 孔德轩;付在明;刘航麟;党浩烊 | 申请(专利权)人: | 电子科技大学 |
主分类号: | G04F10/00 | 分类号: | G04F10/00 |
代理公司: | 电子科技大学专利中心 51203 | 代理人: | 闫树平 |
地址: | 611731 四川省成*** | 国省代码: | 四川;51 |
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摘要: | 本发明属于时间间隔测量领域,具体为一种基于SerDes的TDC实现装置,包括时钟模块、门信号生成模块、SerDes采样接收模块和数据解码模块。该装置基于FPGA内部SerDes资源可达到超高数据率、以及SerDes采样输出为较低速的FPGA可实时处理的并行数据这一特点,通过SerDes采样模块配合数据解码模块,使时间间隔测量范围提升至秒级。此外,利用SerDes采样接收模块中的高性能锁相环和移位寄存器统一的标准延时特点,使该TDC实现装置拥有更好的线性性能,同时省去了时钟多路相移方法中的复杂时钟电路,简化了FPGA外围电路设计、降低了FPGA所需IO口数量和系统复杂度,进而拓宽了其应用范围。 | ||
搜索关键词: | 一种 基于 serdes tdc 实现 装置 | ||
【主权项】:
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