[发明专利]复用的数字比特流的帧重组接口无效
申请号: | 91100517.X | 申请日: | 1991-01-29 |
公开(公告)号: | CN1030743C | 公开(公告)日: | 1996-01-17 |
发明(设计)人: | 杰克斯·古纳昂德;让-鲁普·佛郎特;让-克劳德·费耶;赫维·鲁克斯 | 申请(专利权)人: | 阿尔卡塔尔有限公司 |
主分类号: | H04L29/10 | 分类号: | H04L29/10;H04L5/22 |
代理公司: | 中国国际贸易促进委员会专利商标事务所 | 代理人: | 杜日新 |
地址: | 荷兰阿*** | 国省代码: | 暂无信息 |
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摘要: | 本发明涉及帧重组接口,该接口用于将不同速率的支流经时分复用得到数字比特流,时分复用依据同步复用层次级别,在不同的层次级别上的支流由称作包和复用单元的实体构成。本接口包括从输入帧中提出构成包的信号,及构成和复用形成重组帧的装置,重组帧被分为相同长的段,形成重组帧的复用单元;为使提取和插入信号定时速率匹配,在每一重组帧的段间插入索引和调节信号等主要部分。 | ||
搜索关键词: | 数字 比特流 重组 接口 | ||
【主权项】:
1.一种帧重组接口,用于根据同步复用层次时分复用数字比特流,其特征在于它包括:—装置(50″、50、40、41、53′),用于检测输入帧的位置,这些位置由构成输入帧的已知包的信号占用,称为待处理包,这些装置设有输入端接收所述输入帧;—时基(80),被确定使构成待处包的信号占用输出重组帧中已知位置;—每一待处理包的缓冲存储器(60),设有接收所述输入帧的输入端,与检测由构成待处理包信号占用的输入帧位置的装置输出端相连的写控制输入端,与用于封锁指明构成所述待处理包信号在输出重组帧中位置的时钟信号的某些传递的装置的输出端相连的读控制输入端,所述封锁装置设有与所述时基发送所述时钟信号的输入相连的第一输入端,设有与产生在输出重组帧中所述待处理包调节请求的装置(64)的输出相连的第二输入端。所述产生调节请求的装置又包括节奏比较器;该比较器设有第一输入端,与所述检测待处理包信号所占用的输入帧位置的装置的输出相连,及第二输入端,与所述封锁装置的输出相连;—复用装置(74),设有多个输入端,与不同待处理包相关的不同缓冲存储器(60,61,62,63)输出相连,设有与资料和/或业务信号源输出相连的输入端,设有与计算输出重组帧中待处理包索引信号值的装置(65,69,70,71)输出相连的输入端,设有与所述时基输出相连的控制输入端,及设有构成所述接口输出的输出端,所述计算索引信号值的装置又设置有与产生调节请求的装置输出相连的第一输入端,及与所述时基输出相连的第二输入端。
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