[发明专利]ZQ校准电路的驱动电路及驱动方法有效
| 申请号： | 201810524122.9 | 申请日： | 2018-05-28 |
| 公开（公告）号： | CN108511013B | 公开（公告）日： | 2023-10-20 |
| 发明（设计）人： | 请求不公布姓名 | 申请（专利权）人： | 长鑫存储技术有限公司 |
| 主分类号： | G11C11/4078 | 分类号： | G11C11/4078;G11C11/4094;G11C7/12 |
| 代理公司： | 北京市铸成律师事务所 11313 | 代理人： | 宋珊珊;陈建焕 |
| 地址： | 230000 安徽省合肥市*** | 国省代码： | 安徽;34 |
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| 摘要： | 本发明实施例公开了一种ZQ校准电路的驱动电路及驱动方法，ZQ校准电路用于对动态随机存取存储器的DQ端进行ZQ校准，包括：参考上拉电阻单元，与参考电阻在第一节点连接以向第一节点提供电压，用于确定参考上拉校准码；第一上拉电阻单元，与电源电压连接，第一上拉电阻单元接收参考上拉校准码，以确定第一上拉电阻单元的电阻；以及第一下拉电阻单元，接地，与第一上拉电阻单元在第二节点连接，以向第二节点提供电压，第一下拉电阻单元用于根据第一上拉电阻单元的电阻确定第一下拉校准码；第一上拉电阻单元和第一下拉电阻单元构成ZQ驱动模块，ZQ驱动模块与DQ端的驱动电路的布局相同，参考上拉电阻单元与第一上拉电阻单元的布局相同。 | ||
| 搜索关键词： | zq 校准 电路 驱动 方法 | ||
【主权项】：
1.一种ZQ校准电路的驱动电路，所述ZQ校准电路用于对动态随机存取存储器的DQ端进行ZQ校准，其特征在于，所述驱动电路包括：参考上拉电阻单元，与接地的参考电阻在第一节点连接以向所述第一节点提供电压，用于根据所述参考电阻确定参考上拉校准码；第一上拉电阻单元，与电源电压连接，所述第一上拉电阻单元接收所述参考上拉电阻单元确定的参考上拉校准码，以根据所述参考上拉校准码确定所述第一上拉电阻单元的电阻；以及第一下拉电阻单元，所述第一下拉电阻单元的第一端接地，所述第一下拉电阻单元的第二端与所述第一上拉电阻单元在第二节点连接，以向所述第二节点提供电压，所述第一下拉电阻单元用于根据所述第一上拉电阻单元的电阻确定第一下拉校准码；其中，所述第一上拉电阻单元和所述第一下拉电阻单元构成ZQ驱动模块，所述ZQ驱动模块的布局与所述DQ端的驱动电路的布局相同，且所述参考上拉电阻单元与所述第一上拉电阻单元的布局相同。
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- 本公开是关于一种锤击保护地址确定方法、锤击保护地址确定电路、锤击保护方法、锤击保护电路及电子设备，涉及集成电路技术领域。该锤击保护地址确定电路包括：比较模块，用于在监测到锤击保护指令的情况下，获取当前锤击受损地址，将当前锤击受损地址与保护过的历史锤击受损地址进行比较；选择确定模块，用于若当前锤击受损地址与历史锤击受损地址相同，则将阵列中的预设地址确定为锤击保护地址；若当前锤击受损地址与历史锤击受损地址不同，则将当前锤击受损地址确定为锤击保护地址。本公开提供一种在锤击受损地址保护过程中避免资源浪费的方法。
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- 本公开是关于一种锤击保护地址确定电路、锤击保护地址确定方法、锤击保护电路、锤击保护方法及电子设备，涉及集成电路技术领域。该锤击保护地址确定电路包括：第一锤击监测模块，设置于多个阵列的外部，用于在监测到锤击保护指令的情况下，触发外部锤击保护使能信号；第二锤击监测模块，设置于每个阵列的内部，用于在监测到所在阵列的激活指令后，触发内部锤击保护使能信号；地址确定模块，用于在外部锤击保护使能信号和内部锤击保护使能信号的共同作用下，在有激活指令的阵列中确定出有效保护地址，在没有激活指令的阵列中确定出无效地址。本公开提供一种在锤击受损地址保护过程中避免资源浪费的方法。
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- 本公开是关于一种锤击保护地址确定电路、锤击保护地址确定方法、锤击保护电路、锤击保护方法及电子设备，涉及集成电路技术领域。该锤击保护地址确定电路包括：锤击监测模块，设置于阵列的外部，用于在监测到阵列的激活指令后，触发阵列的内部锤击保护使能信号；外部信号触发模块，用于在一个或多个内部锤击保护使能信号触发的情况下，触发外部锤击保护使能信号；地址确定模块，用于在外部锤击保护使能信号和内部锤击保护使能信号的共同作用下，在有激活指令的阵列中确定出有效保护地址，在没有激活指令的阵列中确定出无效地址。本公开提供一种在锤击受损地址保护过程中避免资源浪费的方法。
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- 2017-01-06 - 2017-05-24 - G11C11/4078
- 本发明一种DRAM锤压侦测电路，提供可物理实现的侦测方案，电路结构简单，实际电路的设计成本低，保证DRAM数据存储的可靠性。其包括，串联移位寄存器链，用来移位锁存DRAM芯片内部激活指令的行地址A_i；输出地址锁存器，连接在串联移位寄存器链末端，用来锁存输出被锤压到的行地址A_o；匹配逻辑电路，输入端分别与输出地址锁存器和每一级移位寄存器输出连接，用于串联移位寄存器链的输出行地址与输出地址锁存器的行地址进行匹配比较；侦测逻辑电路，输入端与匹配逻辑电路的输出连接；侦测逻辑电路输出侦测信号，同时输出反馈信号控制移位寄存器和输出地址锁存器。
- 数据存储设备验证装置及包括连接器的数据存储设备-201210135301.6
- 权们相;姜甫暻;高祯完;宜昌宇;李炳来 - 三星电子株式会社
- 2012-05-02 - 2012-11-07 - G11C11/4078
- 验证装置包括：数据存储单元，用于存储验证装置识别信息；接口单元，用于通过第一接口连接到主机设备；以及验证处理器，其使用存储在数据存储单元中的验证装置识别信息执行验证过程。验证处理器在通过接口单元从主机设备收到验证请求信号时执行验证过程，并经由接口单元将包括表示验证过程的结果的数据的验证响应信号输出到主机设备。验证请求信号用于请求通过第二接口连接到主机设备的数据存储设备的验证。
- 专利分类
