[发明专利]一种自适应识别码速率同步器在审
| 申请号： | 201811307970.0 | 申请日： | 2018-11-05 |
| 公开（公告）号： | CN109450609A | 公开（公告）日： | 2019-03-08 |
| 发明（设计）人： | 康超;王宇;程庆林;陈丽婷;仝维超;陈建斌;鲍中华 | 申请（专利权）人： | 上海航天测控通信研究所 |
| 主分类号： | H04L7/033 | 分类号： | H04L7/033 |
| 代理公司： | 上海汉声知识产权代理有限公司 31236 | 代理人： | 胡晶 |
| 地址： | 200080 上海*** | 国省代码： | 上海;31 |
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| 摘要： | 本发明公开了一种自适应识别码速率同步器，包括码速率识别模块、时码钟产生模块、相位比较模块和调相控制模块，码速率识别模块对基带码流进行采样，统计出基带码流最短脉宽长度，换算出码速率信息并发送给时码钟产生模块，时码钟产生模块根据码速率信息换算出频率控制字配置FPGA自带的DDS IP core，产生一个与基带码流同频的时码钟，相位比较模块对基带码流和时码钟进行沿口比对得到相位误差信息，误差信息送至调相控制模块进行判决，结合基带码流极性变化信息和相位误差情况更改DDS频率字控制字调整时码钟沿口，调整后的沿口再次与基带码流进行相位比对，直至基带码流与时码钟沿口对齐。本发明适用于不同的码速率，通用性好。 | ||
| 搜索关键词： | 时码钟 基带码流 沿口 产生模块 相位比较模块 控制模块 速率识别 速率信息 识别码 同步器 自适应 换算 相位误差信息 频率控制字 极性变化 误差信息 相位比对 相位误差 对齐 短脉宽 结合基 控制字 频率字 采样 比对 码流 同频 自带 并发 判决 配置 统计 | ||
【主权项】：
1.一种自适应识别码速率同步器，其特征在于，包括码速率识别模块、时码钟产生模块、相位比较模块和调相控制模块，所述码速率识别模块对一段时间内的基带码流进行采样，统计出基带码流最短脉宽长度，换算出码速率信息并发送给所述时码钟产生模块，所述时码钟产生模块根据码速率信息换算出频率控制字配置FPGA自带的DDS IP core，产生一个与基带码流同频的时码钟，所述相位比较模块对基带码流和时码钟进行沿口比对得到相位误差信息，误差信息送至所述调相控制模块进行判决，结合基带码流极性变化信息和相位误差情况更改DDS频率字控制字调整时码钟沿口，调整后的沿口再次与基带码流进行相位比对，直至基带码流与时码钟沿口对齐。
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- 2013-06-12 - 2018-04-06 - H04L7/033
- 在一个实施例中，一种装置包括相位检测器单元，其确定反相参考时钟信号与反馈时钟信号之间的相位差。所述装置进一步包括控制器单元，其用于基于所述相位差而生成延迟信号。所述装置进一步包括电压控制延迟线组，其用于基于所述延迟信号而生成相位输出，其中由所述装置将所述相位输出提供给时钟生成器单元来生成过取样时钟信号以用于由接收器进行数据恢复。
- 用于多个线数据信号的时钟恢复电路-201480012389.X
- S·森戈库;C·李;G·A·威利;J·张 - 高通股份有限公司
- 2014-03-07 - 2018-03-16 - H04L7/033
- 提供了包括接收机电路和时钟提取电路的时钟恢复电路。接收机电路可被适配成解码多条数据线路上的差分编码信号，其中至少一个数据码元被差分编码在差分编码信号的状态转变中。时钟提取电路可被适配成从自这些状态转变导出的状态转变信号获取时钟信号，而同时又补偿不同数据线路中的偏斜并掩蔽数据状态转变毛刺。
- 接收机电路和在接收机电路上操作的方法-201480076817.5
- S·森戈库;G·A·威利;C·李 - 高通股份有限公司
- 2014-11-12 - 2018-03-13 - H04L7/033
- 多个线接口被配置成在该多个线接口上接收经扩展信号。该经扩展信号携带在连贯码元之间具有受保障的码元到码元状态转变的码元。该经扩展信号由包括第一线接口上的第一信号在内的多个转变信号来定义。时钟信号基于第一信号的第一实例与第一信号的经延迟的第二实例之间的比较来提取。第一信号的经延迟的第二实例基于该时钟信号来被采样以提供码元输出。时钟提取电路被进一步适配成基于该多个转变信号内第二信号的第一实例与第二信号的经延迟的第二实例之间的附加比较来生成该时钟信号，并且第一信号和第二信号是在不同的线接口上接收到的并发信号。
- 专利分类
