[发明专利]用于模塑衬底的金属重分布层有效
申请号: | 201410490549.3 | 申请日: | 2014-09-23 |
公开(公告)号: | CN104517905B | 公开(公告)日: | 2017-12-22 |
发明(设计)人: | U·瓦赫特;D·迈尔;T·基尔格 | 申请(专利权)人: | 英飞凌科技股份有限公司 |
主分类号: | H01L21/98 | 分类号: | H01L21/98 |
代理公司: | 北京市金杜律师事务所11256 | 代理人: | 王茂华,张宁 |
地址: | 德国诺伊*** | 国省代码: | 暂无信息 |
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摘要: | 本公开涉及用于模塑衬底的金属重分布层。通过在支撑衬底上放置多个半导体裸片、以及采用模塑化合物覆盖半导体裸片以形成模塑结构而封装集成电路,每一个半导体裸片在朝向支撑衬底的侧部上具有多个端子。随后从模塑结构移除支撑衬底以暴露具有端子的半导体裸片的侧部,以及形成在模塑结构上并且与半导体裸片的端子以及模塑化合物直接接触的金属重分布层。形成重分布层而不首先在具有半导体裸片的端子的模塑结构的侧部上形成电介质层。也公开了对应的模塑结构和单独模塑半导体封装。 | ||
搜索关键词: | 用于 衬底 金属 分布 | ||
【主权项】:
一种封装集成电路的方法,所述方法包括:在支撑衬底上放置多个半导体裸片,所述半导体裸片中的每一个半导体裸片在朝向所述支撑衬底的侧部处具有多个端子;采用模塑化合物覆盖所述半导体裸片以形成模塑结构,所述模塑化合物接触每个半导体裸片的边缘面;从所述模塑结构移除所述支撑衬底以暴露所述半导体裸片的具有所述端子的侧部,从而所述边缘面垂直于所述模制化合物未覆盖的侧部延伸;以及形成在所述模塑结构上并且与所述半导体裸片的所述端子和接触每个半导体裸片的边缘面的相同的所述模塑化合物直接接触的金属重分布层,而不在所述模塑结构的具有所述半导体裸片的所述端子的侧部上首先形成电介质层,其中,所述金属重分布层包括与所述半导体裸片的所述端子以及与接触每个半导体裸片的所述边缘面的相同的所述模塑化合物直接接触的焊盘结构,所述焊盘结构具有比所述半导体裸片的所述端子更大的表面面积。
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- 2016-05-13 - 2017-11-21 - H01L21/98
- 本发明公开了一种系统级封装方法及其封装单元。其中,所述系统级封装方法包括将高干扰元件及外围电路元件独立设置,形成电容电阻阵列;通过预定的封装方式,形成若干种确优芯片;堆叠所述电容电阻阵列以及所述确优芯片,形成3D堆叠裸片;将所述3D堆叠裸片与多芯片封装单元与多芯片模组组成至一个系统级封装单元中。将大容量电容、电阻或电感等的高干扰元件及外围电路元件独立设置,成为3D堆叠裸片中的独立的一层,在SIP过程中能够简化布局和提升抗干扰设计,有效的节省了空间,提高了性能。
- 形成叠层封装结构的方法-201310028297.8
- 吕俊麟;刘明凯;吴凯强;杨青峰 - 台湾积体电路制造股份有限公司
- 2013-01-24 - 2017-11-03 - H01L21/98
- 一种方法,包括将半导体管芯附接在晶圆的第一面上,将第一顶部封装件附接在晶圆的第一面上以及将第二顶部封装件附接在晶圆的第一面上。方法进一步包括将封装层沉积在晶圆的第一面上方,其中,第一顶部封装件和第二顶部封装件嵌入到封装层中,对晶圆的第二面施加减薄工艺,将晶圆切割成多个芯片封装件以及将芯片封装件附接至衬底。本发明还提供了形成叠层封装结构的方法。
- 一种基于MCP封装形式的可重构算子阵列结构的规模扩展方法-201110403768.X
- 雍珊珊;王新安;蓝晶;吴承昊;龙晓波;高国华 - 北京大学深圳研究生院;南通富士通微电子股份有限公司
- 2011-12-06 - 2017-10-20 - H01L21/98
- 本发明公开了一种基于MCP封装形式的可重构算子阵列结构的规模扩展方法,所述方法即通过将多个可重构算子阵列结构芯片的临近IO相连,未连接IO引出,经过封装,从而形成更大规模的阵列结构芯片。步骤包括将多块可重构算子阵列结构芯片放在一块基板上,并使其固定;光刻,在所有芯片的IO处形成连接通孔,在需要连接的IO之间形成通道;蒸铝,填充IO的连接通孔以及IO之间的通道,形成第一层金属层;光刻,在需要连接出的IO处形成连接通孔;蒸铝,填充IO的连接通孔,露出电性端子;在每个电性端子处生长凸点,完成封装。本发明提供一种基于MCP封装形式的可重构算子阵列结构的规模扩展方法,使得同一种设计可适应不同规模的应用需求。
- 用于形成集成电路的方法-201210482667.0
- P·巴尔;S·若布洛;N·奥特利尔 - 意法半导体有限公司
- 2012-11-19 - 2017-08-11 - H01L21/98
- 本申请涉及用于形成集成电路的方法。具体地,一种用于形成集成电路的方法,包括步骤a)在第一半导体晶片的前表面中形成开口,开口的深度小于10μm并且将开口填充有传导材料;b)在前表面的有源区中形成部件的掺杂区域,在前表面上形成互连层,以及将支持互连层的表面进行平坦化;c)利用绝缘层覆盖第二半导体晶片的前表面,以及将涂敷有绝缘体的表面进行平坦化;d)将第二半导体晶片的涂敷有绝缘体的前表面施加抵靠在第一半导体晶片的支持互连层的前表面上,以获得在两个晶片之间的键合;e)从第二半导体晶片的后表面形成过孔,以到达第一半导体晶片的互连层;以及f)对第一半导体晶片进行减薄以到达填充有传导材料的开口。
- 专利分类
H01 基本电气元件
H01L 半导体器件;其他类目中不包括的电固体器件
H01L21-00 专门适用于制造或处理半导体或固体器件或其部件的方法或设备
H01L21-02 .半导体器件或其部件的制造或处理
H01L21-64 .非专门适用于包含在H01L 31/00至H01L 51/00各组的单个器件所使用的除半导体器件之外的固体器件或其部件的制造或处理
H01L21-66 .在制造或处理过程中的测试或测量
H01L21-67 .专门适用于在制造或处理过程中处理半导体或电固体器件的装置;专门适合于在半导体或电固体器件或部件的制造或处理过程中处理晶片的装置
H01L21-70 .由在一共用基片内或其上形成的多个固态组件或集成电路组成的器件或其部件的制造或处理;集成电路器件或其特殊部件的制造
H01L 半导体器件;其他类目中不包括的电固体器件
H01L21-00 专门适用于制造或处理半导体或固体器件或其部件的方法或设备
H01L21-02 .半导体器件或其部件的制造或处理
H01L21-64 .非专门适用于包含在H01L 31/00至H01L 51/00各组的单个器件所使用的除半导体器件之外的固体器件或其部件的制造或处理
H01L21-66 .在制造或处理过程中的测试或测量
H01L21-67 .专门适用于在制造或处理过程中处理半导体或电固体器件的装置;专门适合于在半导体或电固体器件或部件的制造或处理过程中处理晶片的装置
H01L21-70 .由在一共用基片内或其上形成的多个固态组件或集成电路组成的器件或其部件的制造或处理;集成电路器件或其特殊部件的制造