[发明专利]半导体装置及其制造方法有效
申请号: | 201610236602.6 | 申请日: | 2016-04-15 |
公开(公告)号: | CN106373893B | 公开(公告)日: | 2019-08-02 |
发明(设计)人: | 本间庄一;志摩真也;高野勇佑;渡部武志;涩谷克则 | 申请(专利权)人: | 东芝存储器株式会社 |
主分类号: | H01L21/50 | 分类号: | H01L21/50;H01L21/56;H01L23/488 |
代理公司: | 北京律盟知识产权代理有限责任公司 11287 | 代理人: | 张世俊 |
地址: | 日本*** | 国省代码: | 日本;JP |
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摘要: | 本发明的实施方式提供一种能够使半导体装置的制造容易的半导体装置及其制造方法。根据实施方式的制造方法,于在一面侧隔着粘接剂而包含多个半导体元件、且在另一面包含与半导体元件电连接的外部输入输出端子的衬底的一面上,模铸包含氧化硅的密封树脂层。在以另一面成为下侧的方式将多个被切断的衬底收纳在托盘的状态下,对衬底的密封树脂层的表面进行溅镀蚀刻。溅镀蚀刻是使氧化硅的被密封树脂层覆盖的部分的一部分露出。在将衬底收纳在托盘的状态下溅镀金属层。 | ||
搜索关键词: | 半导体 装置 及其 制造 方法 | ||
【主权项】:
1.一种半导体装置的制造方法,其特征在于:于在一面侧隔着粘接剂而包含多个半导体元件、且在另一面包含与所述半导体元件电连接的外部输入输出端子的衬底的所述一面上,模铸包含氧化硅的密封树脂层,以与所述外部输入输出端子中会成为接地电位的外部输入输出端子电连接的导体从剖面露出的方式,将已模铸的所述衬底切断,在以所述另一面成为下侧的方式将多个被切断的所述衬底收纳在托盘的状态下,对所述衬底的所述密封树脂层的表面在减压环境下使用包含氩与氮的等离子体进行溅镀蚀刻,一面从所述溅镀蚀刻维持减压环境,一面在将所述衬底收纳在所述托盘的状态下在所述表面及所述切断面上以与所述导体电连接的方式溅镀金属层,所述溅镀是在将多个所述托盘载置在载体上的状态下进行,在进行所述溅镀的期间,所述托盘的所述衬底的正下方的至少一部分与所述载体的一部分接触,多个所述衬底收纳在所述托盘中由多个分隔区域分隔的区域,在第1区域与第2区域的所述托盘的高度的差较在所述第1区域与所述第2区域的所述载体的高度的差小,所述第1区域是指从上方观察较所述多个分隔区域中配置多个所述衬底的区域的最外周的分隔区域更外侧且与所述第2区域相比,所述载体的高度不同的区域,所述第2区域是指从上方观察与所述衬底重叠且所述托盘的高度较高的区域,且所述溅镀蚀刻是使所述氧化硅的被所述密封树脂层覆盖的部分的一部分露出。
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H01 基本电气元件
H01L 半导体器件;其他类目中不包括的电固体器件
H01L21-00 专门适用于制造或处理半导体或固体器件或其部件的方法或设备
H01L21-02 .半导体器件或其部件的制造或处理
H01L21-64 .非专门适用于包含在H01L 31/00至H01L 51/00各组的单个器件所使用的除半导体器件之外的固体器件或其部件的制造或处理
H01L21-66 .在制造或处理过程中的测试或测量
H01L21-67 .专门适用于在制造或处理过程中处理半导体或电固体器件的装置;专门适合于在半导体或电固体器件或部件的制造或处理过程中处理晶片的装置
H01L21-70 .由在一共用基片内或其上形成的多个固态组件或集成电路组成的器件或其部件的制造或处理;集成电路器件或其特殊部件的制造
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